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Evaluation of Stencil Based Algorithm Parallelization over System-on-Chip FPGA Using a High Level Synthesis Tool

Acceso Cerrado

ID Minciencias: ART-0000043249-125

Ranking: ART-GC_ART

Idioma: Inglés

Publicado: 01/01/2019

APC (est): No disponible

Abstract no disponible

Embedded Systems Design Techniques

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FuenteCommunications in computer and information science	Cuartil año de publicaciónNo disponible	VolumenNo disponible
IssueNo disponible	Páginas52 - 63	pISSNNo disponible
ISSN1865-0929	Perfil OpenAlexhttps://openalex.org/S2764900261

Scienti ID	0000043249-125	Minciencias ID	ART-0000043249-125	Doi URL	https://doi.org/10.1007/978-3-030-31019-6_5
Uri URL	http://hdl.handle.net/20.500.12622/3219	Scholar URL	https://scholar.google.com/scholar?hl=en&as_sdt=0%2C5&q=info%3A__awdqggx_UJ%3Ascholar.google.com&btnG=	Oaipmh URL	http://repositorio.itm.edu.co/oai/request?verb=GetRecord&metadataPrefix=dim&identifier=oai:repositorio.itm.edu.co:20.500.12622/3219
Openalex URL	https://openalex.org/W2980186989	Dspace URL	https://repositorio.itm.edu.co/handle/20.500.12622/3219

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