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Hecho en Colombia
Laura J Oyuela Eslava
Universidad de los Andes
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Evaluation of lot release policies for cycle time improvement in semiconductor manufacturing systems: a Petri net approach
Acceso Cerrado
TP-TP_B
ID Minciencias: TP-0001446779-23
Fuente: Winter Simulation Conference
Laura J Oyuela Eslava
Raha Akhavan Tabatabaei
(Asesor)
Temas:
Petri net
Computer science
Control (management)
Semiconductor device fabrication
Industrial engineering
Stochastic Petri net
Net (polyhedron)
Reduction (mathematics)
Reliability engineering
Operations research
Distributed computing
Artificial intelligence
Engineering
Mathematics
Geometry
Wafer
Electrical engineering
Publicado: 2012
Citaciones:
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Altmétricas:
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Tesis de Pregrado
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